//					FR Family SOFTUNE cpcom V65L08
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	.global	_IO_EPFR35
	.global	_IO_EPFR36
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	.global	_IO_EPFR41
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	.global	_IO_EPFR55
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	.global	_IO_PPCR01
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	.global	_IO_PPCRG
	.global	_IO_PPCRH
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	.global	_IO_PPER01
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	.global	_IO_PPER03
	.global	_IO_PPER04
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	.global	_IO_PPER06
	.global	_IO_PPER07
	.global	_IO_PPER08
	.global	_IO_PPER09
	.global	_IO_PPER10
	.global	_IO_PPER11
	.global	_IO_PPER12
	.global	_IO_PPER13
	.global	_IO_PPERA
	.global	_IO_PPERB
	.global	_IO_PPERC
	.global	_IO_PPERD
	.global	_IO_PPERE
	.global	_IO_PPERF
	.global	_IO_PPERG
	.global	_IO_PPERH
	.global	_IO_PILR00
	.global	_IO_PILR01
	.global	_IO_PILR02
	.global	_IO_PILR03
	.global	_IO_PILR04
	.global	_IO_PILR05
	.global	_IO_PILR06
	.global	_IO_PILR07
	.global	_IO_PILR08
	.global	_IO_PILR09
	.global	_IO_PILR10
	.global	_IO_PILR11
	.global	_IO_PILR12
	.global	_IO_PILR13
	.global	_IO_PILRA
	.global	_IO_PILRB
	.global	_IO_PILRC
	.global	_IO_PILRD
	.global	_IO_PILRE
	.global	_IO_PILRF
	.global	_IO_PILRG
	.global	_IO_PILRH
	.global	_IO_EPILR06
	.global	_IO_EPILR07
	.global	_IO_EPILR08
	.global	_IO_EPILR09
	.global	_IO_EPILR10
	.global	_IO_EPILR11
	.global	_IO_EPILR12
	.global	_IO_EPILR13
	.global	_IO_PODR06
	.global	_IO_PODR07
	.global	_IO_PODR08
	.global	_IO_PODR09
	.global	_IO_PODR10
	.global	_IO_PODR11
	.global	_IO_PODR12
	.global	_IO_PODR13
	.global	_IO_EPODR06
	.global	_IO_EPODR07
	.global	_IO_EPODR08
	.global	_IO_EPODRGD
	.global	_IO_EPODRGF
	.global	_IO_PORTEN
	.global	_IO_GDC
	.global	_IO_FT2
	.global	_IO_FT3
	.global	_IO_IPCP6
	.global	_IO_IPCP7
	.global	_IO_ICFS67
	.global	_IO_LSYNS1
	.global	_IO_ICS67
	.global	_IO_SACR
	.global	_IO_PICD
	.global	_IO_SGR0
	.global	_IO_SGR1
	.global	_IO_SGR2
	.global	_IO_SGR3
	.global	_IO_SGR4
	.global	_IO_CRCCR
	.global	_IO_CRCINIT
	.global	_IO_CRCIN
	.global	_IO_CRCR
	.global	_IO_CAN0
	.global	_IO_CAN1
	.global	_IO_CAN2
	.global	_IO_DFCTLR
	.global	_IO_DFSTR
	.global	_IO_FLIFCTLR
	.global	_IO_SEEARX
	.global	_IO_DEEARX
	.global	_IO_EECSRX
	.global	_IO_EFEARX
	.global	_IO_EFECRX
	.global	_IO_SEEARA
	.global	_IO_DEEARA
	.global	_IO_EECSRA
	.global	_IO_EFEARA
	.global	_IO_EFECRA
	.global	_IO_DSUCR
	.global	_IO_PCSR
	.global	_IO_PSSR
	.global	_IO_EDIR1
	.global	_IO_EDIR0
	.section	DATA, DATA, align=4
	.global	_f_VSYNC
	.align	1
_f_VSYNC:
	.res.b	1
	.global	_f_RLD
_f_RLD:
	.res.b	1
	.global	_f_DMA1
_f_DMA1:
	.res.b	1
	.global	_f_DMA0
_f_DMA0:
	.res.b	1
	.global	_DISP
_DISP:
	.res.b	3
	.global	_GdcClrBitRegister
	.global	_GdcSetBitRegister
	.global	_GdcWriteRegister
	.global	_GdcReadRegister
	.global	___wait_nop
	.section	CODE, CODE, align=2
	.global	_init_SPIFlash
	._SYMBOL	"init_SPIFlash", F, 0x8000000f, E, "_init_SPIFlash", F
	._FPARAM	S, 0, F
	._FPARAM	E
	._CONFIG	S, F, 1
	._LINE	0, 36
_init_SPIFlash:
L_20:
	ST	RP,@-SP
	ENTER	#8
;-------end_of_no_optimize_block
	._FUNCTION	"fp", "fp", 24
	._CONFIG	S, B
	._SYMBOL	"addr", V, 0x80000008, A, -4
	._POINTER	1
	._TYPED	V
L_21:				// Pred: L_20
	._LINE	0, 38
	._LINE	0, 40
	LDI	#37433356,R0
	ST	R0,@(FP,-4)	; _addr
	._LINE	0, 41
	LD	@(FP,-4),R0	; _addr
	LDI	#4608,R1
	ST	R1,@R0
L_22:				// Pred: L_21
	._LINE	0, 41
	._CONFIG	E
	._LINE	0, 42
	LEAVE
	LD	@SP+,RP
	RET
	._CONFIG	E
	.global	_supply_PowerToGDC0
	._SYMBOL	"supply_PowerToGDC0", F, 0x8000000f, E, "_supply_PowerToGDC0", F
	._FPARAM	S, 0, F
	._FPARAM	E
	._CONFIG	S, F, 1
	._LINE	0, 45
_supply_PowerToGDC0:
L_23:
	ST	RP,@-SP
	ENTER	#4
;-------end_of_no_optimize_block
	._FUNCTION	"fp", "fp", 16
	._CONFIG	S, B
L_24:				// Pred: L_23
	._LINE	0, 53
	LDI:32	#_IO_GCTLR,R1
	LDI	#166,R0
	STB	R0,@R1	; _IO_GCTLR
	._LINE	0, 63
	LDI	#162,R0
	STB	R0,@R1	; _IO_GCTLR
	._LINE	0, 69
	LDI:32	#_IO_GSTR,R2
L_28:				// Pred: L_29 L_24
	._LINE	0, 69
	._LINE	0, 69
	._LINE	0, 70
	BTSTH	#0x8,@R2
	BNE32	L_31,R12
L_29:				// Pred: L_28
	._LINE	0, 70
	._LINE	0, 71
	BRA32	L_28,R12
L_31:				// Pred: L_28
	._LINE	0, 81
	LDI	#160,R0
	STB	R0,@R1	; _IO_GCTLR
L_32:				// Pred: L_31
	._LINE	0, 81
	._CONFIG	E
	._LINE	0, 83
	LEAVE
	LD	@SP+,RP
	RET
	._CONFIG	E
	.global	_test_clock
	._SYMBOL	"test_clock", F, 0x8000000f, E, "_test_clock", F
	._FPARAM	S, 0, F
	._FPARAM	E
	._CONFIG	S, F, 1
	._LINE	0, 85
_test_clock:
L_33:
	ST	RP,@-SP
	ENTER	#4
;-------end_of_no_optimize_block
	._FUNCTION	"fp", "fp", 16
	._CONFIG	S, B
L_34:				// Pred: L_33
	._LINE	0, 87
	LDI:32	#_IO_PFR05,R0
	LDI	#104,R13
	STB	R13,@R0	; _IO_PFR05
	._LINE	0, 88
	LDI:32	#_IO_DDR05,R0
	STB	R13,@R0	; _IO_DDR05
	._LINE	0, 96
	DMOVB	R13,@_IO_PDR05	; _IO_PDR05
	._LINE	0, 98
	LDI:32	#_IO_EPFR55,R0
	LDI	#253,R1
	STB	R1,@R0	; _IO_EPFR55
	._LINE	0, 99
	LDI:32	#_IO_EPFR52,R0
	LDI	#255,R2
	STB	R2,@R0	; _IO_EPFR52
	._LINE	0, 101
	LDI:32	#_IO_PFRD,R1
	LDI	#252,R13
	STB	R13,@R1	; _IO_PFRD
	._LINE	0, 103
	LDI:32	#_IO_EPFR48,R1
	STB	R2,@R1	; _IO_EPFR48
	._LINE	0, 106
	LDI:32	#_IO_PFRE,R1
	STB	R13,@R1	; _IO_PFRE
	._LINE	0, 108
	LDI:32	#_IO_EPFR49,R1
	STB	R2,@R1	; _IO_EPFR49
	._LINE	0, 110
	LDI:32	#_IO_PFRF,R1
	STB	R13,@R1	; _IO_PFRF
	._LINE	0, 112
	LDI:32	#_IO_EPFR50,R1
	STB	R2,@R1	; _IO_EPFR50
	._LINE	0, 115
	LDI:32	#_IO_PFR01,R1
	LDI	#126,R2
	STB	R2,@R1	; _IO_PFR01
	._LINE	0, 120
	LDI:32	#_IO_PFRA,R1
	LDI	#0,R3
	STB	R3,@R1	; _IO_PFRA
	._LINE	0, 121
	LDI:32	#_IO_DDRA,R1
	STB	R3,@R1	; _IO_DDRA
	._LINE	0, 122
	DMOVB	R13,@_IO_PDRA	; _IO_PDRA
	._LINE	0, 131
	LDI:32	#_IO_PFRB,R1
	STB	R3,@R1	; _IO_PFRB
	._LINE	0, 132
	LDI:32	#_IO_DDRB,R1
	STB	R3,@R1	; _IO_DDRB
	._LINE	0, 133
	DMOVB	R13,@_IO_PDRB	; _IO_PDRB
	._LINE	0, 139
	LDI:32	#_IO_PFRG,R0
	LDI	#240,R13
	STB	R13,@R0	; _IO_PFRG
	._LINE	0, 141
	LDI:32	#_IO_DDRG,R0
	STB	R13,@R0	; _IO_DDRG
	._LINE	0, 143
	DMOVB	R13,@_IO_PDRG	; _IO_PDRG
	._LINE	0, 144
	LDI:32	#_IO_EPFR51,R1
	LDI	#239,R0
	STB	R0,@R1	; _IO_EPFR51
L_35:				// Pred: L_34
	._LINE	0, 144
	._CONFIG	E
	._LINE	0, 146
	LEAVE
	LD	@SP+,RP
	RET
	._CONFIG	E
	.global	_Gdc_init
	._SYMBOL	"Gdc_init", F, 0x8000000f, E, "_Gdc_init", F
	._FPARAM	S, 0, F
	._FPARAM	E
	._CONFIG	S, F, 1
	._LINE	0, 150
_Gdc_init:
L_82:
	ST	RP,@-SP
	ENTER	#12
;-------end_of_no_optimize_block
	._FUNCTION	"fp", "fp", 24
	._CONFIG	S, B
	._SYMBOL	"i", V, 0x80000008, A, -8
	._TYPED	V
	._SYMBOL	"addr", V, 0x80000008, A, -4
	._POINTER	1
	._TYPED	V
L_83:				// Pred: L_82
	._LINE	0, 154
	._LINE	0, 154
	LDI	#0,R0
	ST	R0,@(FP,-8)	; _i
	._LINE	0, 181
	CALL21	_test_clock
	._LINE	0, 185
	CALL21	_supply_PowerToGDC0
	._LINE	0, 218
	LDI:32	#_IO_GDC+5,R0
	LDI	#53,R1
	STB	R1,@R0	; _IO_GDC
	._LINE	0, 222
	LDI:32	#_IO_GDC+6,R0
	LDI	#8,R4
	STB	R4,@R0	; _IO_GDC
	._LINE	0, 227
	LDI:32	#_IO_GDC+7,R0
	STB	R4,@R0	; _IO_GDC
	._LINE	0, 233
	LDI:32	#_IO_GDC+3,R0
	LDI	#1,R5
	STB	R5,@R0	; _IO_GDC
	._LINE	0, 242
	LDI:32	#_IO_GDC+1,R7
	STB	R5,@R7	; _IO_GDC
	._LINE	0, 247
L_84:				// Pred: L_85 L_83
	._LINE	0, 247
	._LINE	0, 247
	._LINE	0, 248
	BTSTH	#0x8,@R7
	BNE32	L_87,R12
L_85:				// Pred: L_84
	._LINE	0, 248
	._LINE	0, 249
	BRA32	L_84,R12
L_87:				// Pred: L_84
	._LINE	0, 265
	LDI:32	#_IO_GDC+21,R3
	BOR	#0x2,@R3
	._LINE	0, 266
	LDUB	@R3,R1	; _IO_GDC
	LDI:8	#-49,R0
	EXTSB	R0
	AND	R0,R1
	LDI	#16,R0
	OR	R0,R1
	STB	R1,@R3	; _IO_GDC
	._LINE	0, 268
	BAND	#0xFE,@R3
	._LINE	0, 272
	LDI:32	#_IO_IRPR6H,R2
L_88:				// Pred: L_92 L_87
	._LINE	0, 272
	._LINE	0, 272
	._LINE	0, 273
	LDUB	@R2,R0	; _IO_IRPR6H
	LDI	#128,R6
	AND	R6,R0
	CMP	R6,R0
	BNE32	L_90,R12
L_89:				// Pred: L_88
	._LINE	0, 273
	._LINE	0, 274
	BRA32	L_93,R12
L_90:				// Pred: L_88
	._LINE	0, 276
	LD	@(FP,-8),R1	; _i
	LDI	#80000,R0
	CMP	R0,R1
	BC32	L_92,R12
L_91:				// Pred: L_90
	._LINE	0, 276
	._LINE	0, 277
	BRA32	L_93,R12
L_92:				// Pred: L_90
	._LINE	0, 279
	LD	@(FP,-8),R0	; _i
	ADDN	#1,R0
	ST	R0,@(FP,-8)	; _i
	._LINE	0, 280
;-------volatile_access
	NOP
;-------end_of_no_optimize_block
	._LINE	0, 281
;-------volatile_access
	NOP
;-------end_of_no_optimize_block
	._LINE	0, 282
	BRA32	L_88,R12
L_93:				// Pred: L_91 L_89
	._LINE	0, 284
	LDI	#37429504,R0
	ST	R0,@(FP,-4)	; _addr
	._LINE	0, 291
	LD	@(FP,-4),R0	; _addr
	LDI:8	#-1,R1
	EXTSB	R1
	ST	R1,@R0
	._LINE	0, 308
	CALL21	_init_SPIFlash
	._LINE	0, 394
	LDI:32	#_IO_ICR+29,R1
	LDI	#20,R0
	STB	R0,@R1
	._LINE	0, 397
	LDI	#33235216,R4
	LDI	#4,R5
	CALL21	_GdcWriteRegister
	._LINE	0, 401
	LDI	#33235200,R4
	LDI	#29360260,R5
	CALL21	_GdcWriteRegister
	._LINE	0, 409
	LDI	#33235232,R4
	LDI	#29360164,R5
	CALL21	_GdcWriteRegister
L_94:				// Pred: L_93
	._LINE	0, 409
	._CONFIG	E
	._LINE	0, 416
	LEAVE
	LD	@SP+,RP
	RET
	._CONFIG	E
	.global	_gdc_interrupt
	._SYMBOL	"gdc_interrupt", F, 0x8000000f, E, "_gdc_interrupt", I
	._FPARAM	S, 0, F
	._FPARAM	E
	._CONFIG	S, F, 1
	._LINE	0, 421
_gdc_interrupt:
L_55:
	STM	(R0,R1,R2,R3,R4,R5,R6,R7,R8,R12,R13)
	ST	MDH,@-SP
	ST	MDL,@-SP
	FSTM	(FR0,FR1,FR2,FR3,FR4,FR5,FR6,FR7)
	ST	FCR,@-SP
	ST	RP,@-SP
	ENTER	#8
;-------end_of_no_optimize_block
	._FUNCTION	"fp", "fp", 24
	._CONFIG	S, B
	._SYMBOL	"val", V, 0x80000008, A, -4
L_56:				// Pred: L_55
	._LINE	0, 423
	._LINE	0, 430
	LDI	#33243156,R4
	CALL21	_GdcReadRegister
	ST	R4,@(FP,-4)	; _val
	._LINE	0, 434
	LD	@(FP,-4),R4	; _val
	LDI	#524288,R8
	AND	R8,R4
	BEQ32	L_58,R12
L_57:				// Pred: L_56
	._LINE	0, 434
	._LINE	0, 435
	LDI	#33243156,R4
	LDI	#524288,R5
	CALL21	_GdcClrBitRegister
	._LINE	0, 436
	LD	@(FP,-4),R3	; _val
	LDI	#458752,R0
	AND	R0,R3
	BEQ32	L_60,R12
L_59:				// Pred: L_57
	._LINE	0, 436
	._LINE	0, 438
	LDI:32	#_f_DMA0,R1
	LDI	#1,R0
	STB	R0,@R1	; _f_DMA0
	._LINE	0, 439
	BRA32	L_58,R12
L_60:				// Pred: L_57
	._LINE	0, 440
	._LINE	0, 441
	LDI	#33243156,R4
	LDI	#524288,R5
	CALL21	_GdcSetBitRegister
	._LINE	0, 443
L_58:				// Pred: L_60 L_59 L_56
	._LINE	0, 447
	LDI	#33243172,R4
	CALL21	_GdcReadRegister
	ST	R4,@(FP,-4)	; _val
	._LINE	0, 451
	LD	@(FP,-4),R5	; _val
	AND	R8,R5
	BEQ32	L_63,R12
L_62:				// Pred: L_58
	._LINE	0, 451
	._LINE	0, 452
	LDI	#33243172,R4
	LDI	#524288,R5
	CALL21	_GdcClrBitRegister
	._LINE	0, 453
	LD	@(FP,-4),R6	; _val
	LDI	#458752,R0
	AND	R0,R6
	BEQ32	L_65,R12
L_64:				// Pred: L_62
	._LINE	0, 453
	._LINE	0, 454
	LDI:32	#_f_DMA1,R0
	LDI	#1,R1
	STB	R1,@R0	; _f_DMA1
	._LINE	0, 456
	BRA32	L_63,R12
L_65:				// Pred: L_62
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	._LINE	0, 458
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